1. Feng Chia University Institutional Repository

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題名作者日期
A 500MHz, 8-Stage Pipeline RISC Microprocessor Design with Sub-ComputingHu, Ya-Lun; Chang, Ming-Ku; Chen, Tien-Fu; Shiu, Fang-Yu; Cheng, You-Hsiang2007-01-25T06:12:32Z
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